计算机软件及计算机应用论文_可重构高速数据加

文章摘要:为解决SM4传统加解密方式存在的速度慢、效率低、占用CPU计算资源的问题，提出了一种可重构高速数据加密系统。该系统基于Xilinx Virtex UltraScale VU9p FPGA，利用PCIe热插拔特性，可快速应用于办公主机或服务器，通过PCIe高速接口实现数据的快速传输，在FPGA内实现并行可调度SM4算法逻辑，设计有专用DMA模块，实现旁路主机CPU传输明文密文，减少主机端资源占用；采用FPGA实现的加解密系统具备可重构性，大大降低了算法迭代的硬件成本。系统分析测试和实验结果表明，该系统实现了数据的高速可靠传输与加密，总线速率达到8GT/s，能有效满足大容量数据快速加解密的需求；采用并行可调度流水线加解密，较CPU实现方式，加解密速率提升约25.78倍。

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论文分类号:TP309.7

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